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苏变玲 《渭南师范学院学报》2002,17(2):22-25
在进行同步时序逻辑电路设计时，可在状态分配之后，先对状态表进行仔细的观察，然后可根据所选用的触发器的状态图，通过对触发器状态翻转条件的高度概括写出驱动方程；也可根据所选用的触发器的驱动表，利用卡诺图，直接写出驱动方程。 相似文献
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倪树范 《绵阳师范学院学报》2000,(5)
通过实际例子 ,阐述了次态卡诺图在分析和设计时序逻辑电路中的使用方法。该方法的使用可以使时序逻辑电路的分析和设计得到一定的简化 ,过程中思路清晰 ,状态转换直观。 相似文献
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次态卡诺图在时序逻辑电路分析和设计中的运用 总被引：1，自引：0，他引：1
倪树范 《绵阳师范高等专科学校学报》2000,(5):30-37
通过实际例子,阐述了次态卡诺图在分析和设计时序逻辑电路中的使用方法。该方法的使用可以使时序逻辑电路的分析和设计得到一定的简化,过程中思路清晰,状态转换直观。 相似文献
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介绍了FPGA器件的基本结构及设计特点,分析了采用FPGA进行电路设计的优势。选用Altera公司的F1ex10K系列FPGA器件EPF10K10LC84—4,以交通信号灯控制系统为例,讨论了采用FPGA进行时序逻辑电路设计的思路与方法,使用硬件描述语言Verilog HDL作为输入,给出了核心部分的主要程序代码。最后进行了时序波形的仿真,并对相关波形中出现的毛刺现象进行了相应分析。 相似文献
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异步时序逻辑电路的卡诺图分析法 总被引：2，自引：0，他引：2
李永生 《淮北职业技术学院学报》2002,1(1):65-67
学生对异步时序逻辑电路分析时易出错,现介绍一种利用次态卡诺图分析时序逻辑电路的方法,它简便易行,清晰明了。 相似文献
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提出了一种分析时序逻辑电路功能的新方法：利用分项满足法和时钟方程来填写状态方程的卡诺图，并由卡诺图直接画出状态转换图。 相似文献
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数字逻辑电路与竞争冒险 总被引：1，自引：0，他引：1
吴瑞坤 《宁德师专学报(自然科学版)》1999,(4)
比较系统地分析了组合逻辑电路和时序逻辑电路的竞争冒险现象,并介绍消除此类干扰的方法． 相似文献
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林蔚 《Journal of Zhangzhou Technical Institute》2002,4(3):9-10
讨论脉冲异步时序电路分析与设计中的一些问题,指出状态信号反馈对触发器时钟信号及传输延迟状态转换的影响。 相似文献
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采用小规模集成电路作为电路单元进行异步时序电路设计时,除了需要完成设计同步时序电路所做的各项工作之外,还要遵循挑选时钟信号的原则、求解状态方程的原则.本文通过一个设计实例,讨论、分析了异步时序电路设计的一般规律及其特殊的特点. 相似文献
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