| 基于FPGA与千兆以太网的测试系统设计 |
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| 引用本文： | 成雅丽,李锦明,成乃朋. 基于FPGA与千兆以太网的测试系统设计[J]. 实验室研究与探索, 2019, 0(6): 115-119,124 |
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| 作者姓名： | 成雅丽 李锦明 成乃朋 |
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| 作者单位： | 中北大学仪器与电子学院 |
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| 摘 要： | 为实现对前端数据高速有效的采集、分析和处理,提出了一种基于FPGA与千兆以太网的测试系统的设计。系统采用串口以及A/D芯片完成对前端数据的采集,以FPGA为逻辑控制核心对采集到的数据进行编帧处理,通过GMII总线将处理好的数据发送至以太网模块中的Gigabit PHY芯片,Gigabit PHY芯片通过网线进一步和PC进行数据交换。系统采用UDP完成与上位机的通信,并且使用上位机对接收的数据进行处理和显示。测试结果表明,系统数据传输速度能够达到900 Mb/s以上,接收到的数据未出现丢帧现象,可靠性高,具有良好的稳定性。
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| 关 键 词： | 测试系统 现场可编程门阵列 千兆以太网 用户数据报协议 上位机 高速数据 |
Design of Test System Based on FPGA and Gigabit Ethernet |
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| CHENG Yali,LI Jinming,CHENG Naipeng. Design of Test System Based on FPGA and Gigabit Ethernet[J]. Laboratory Research and Exploration, 2019, 0(6): 115-119,124 |
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| Authors: | CHENG Yali LI Jinming CHENG Naipeng |
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| Affiliation: | (School of Instrument and Electronics,North University of China,Taiyuan 030051,China) |
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| Abstract: | CHENG Yali;LI Jinming;CHENG Naipeng(School of Instrument and Electronics,North University of China,Taiyuan 030051,China) |
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| Keywords: | test system field programmable gate arrag(FPGA) gigabit Ethernet user datagram protocol(UDP) host computer high speed data |
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